Low power multiplier accumulator (MAC) unit using sleepy stack technique
The main objective of this final year project is to provide new low power solutions for Very Large Scale Integration (VLSI) designers. In this final year project, a novel circuit structure called "sleepy stack" is presented. The sleepy stack is a combination of two well known low-leakage t...
Պահպանված է:
Հիմնական հեղինակ: | Aaron Selvam Thangamany (Հեղինակ) |
---|---|
Ձևաչափ: | Էլեկտրոնային Ծրագրային ապահովում Շտեմարան |
Լեզու: | English |
Խորագրեր: | |
Ցուցիչներ: |
Ավելացրեք ցուցիչ
Չկան պիտակներ, Եղեք առաջինը, ով նշում է այս գրառումը!
|
Նմանատիպ նյութեր
-
Low power multiplier accumulator (MAC) unit using multiple threshold CMOS
: Thin, Tan Fhan -
Design and realization of high speed multiplier accumulator (MAC) unit for low power applications
: Mohd Nazri Mad Rejab -
Design and analysis of low power ALU unit, program counter and instruction register using sleepy stack technique
: Wan Nurul Liyana Wan Zulkefle -
Analysis & design low power multiplier using TSMC 0.18um CMOS technology /
: Norsaifulrudin Mat Zuki
Հրապարակվել է: (2008) -
Design and analysis of floting point multiplier
: Zariah Asari